PG电子全网做比较最全的）计算机组成原理总结及知识网图（点赞收藏4、指令由操作码和地址码组成。操作码用来表示操作的性质，地址码用来表示操作数在存储器中的位置。

　　5、指令在存储器内按顺序存放。通常，指令是顺序执行的，在特定条件下可根据运算结果或根据设定的条件改变执行顺序。

　　机器字长： 指计算机进行一次整数运算所能处理的二进制数据的位数。（通常与CPU的寄存器、加法器有关。

　　数据通路宽带：指数据总线一次所能并行传送信息的位数（指外部数据总线的宽度，与CPU内部的数据总线宽度有可能不同）

　　主存容量： 指主存储器所能存储信息的最大容量，通常以字节来衡量，也可用字数字长来表述存储容量。

　　2、响应时间:指从用户向计算机发送一个请求到系统对该请求做出响应并获得所需结果的等待时间。通常包括CPU时间（运行一个程序所花费的时间）与等待时间（用于磁盘访问、存储器访问、I/O操作、操作系统开销等时间）

　　在一个刷新周期内，利用一段固定的时间，依次对存储器的所有行进行逐一再生，期间停止对存储器的读写操作，即死时间，访存“死区”。

　　把对每行的刷新分散到各个工作周期中，一个存储器的系统工作周期分为两部分：前半部分用于正常读写或保持；后半部分用于刷新某一行。

　　是指在最近的未来要用到的信息，很可能与现在正在使用的信息在存储空间上是邻近的PG电子(中国)官方网站，因为指令通常是顺序存放，顺序执行的。

　　利用程序访问的局部性原理，把程序中正在使用的部分存放在一个高速的容量较小的Cache中，使CPU的访存操作大多数针对Cache进行，从而大大提高程序的执行速度。

　　CPU使用续存时，由辅存硬件找出虚地址与实地址之间的对应关系，并判断这个虚地址对应的存储单元是否已装入主存。若已在主存中，则通过地址转换，CPU可直接访问主存指示的实际单元；若不在主存中，则把包含这个字的一页或一段调入主存后再由CPU访问。若主存已满PG电子(中国)官方网站，则采用替换算法置换主存的一页或一段。

　　通常采用全相联或组相联方式，每个TLB项由页表表项内容加上一个TLB标记字段组成，TLB标记用来表示该表项曲子页表中的哪个虚页号对应的页表项，所以TLB标记的内容在全相联方式下表示该页表项对应的虚页号；组相联方式下表示对应虚页号的高位部分，虚页号的低位部分用于选择TLB组的组索引。

　　2.Cache由硬件实现，是硬件存储器，对所有程序员透明；而虚拟存储器由OS和硬件共同实现，是逻辑上的存储器，对系统程序员不透明，对应用程序员透明；

　　2.操作控制：CPU管理并产生由内存取出的每条指令的操作信号，把各种操作信号送往相应的部件，从而控制这些部件按指令的要求进行动作。

　　根据指令操作码、指令的执行步骤（微命令序列）和条件信号来形成当前计算机各部件要用到的控制信号。计算机整机各硬件系统在这些控制信号的控制下协同运行，产生预期的执行结果。

　　2.输入输出设备通过接口电路与总线.内存储器、输入输出设备从地址总线接收地址信息，从控制总线得到控制信号，通过数据总线与其他部件传送数据。

　　4.部件从数据总线接收指令信息，从运算器部件接收指令转移地址，送出指令地址到地址总线，还要向系统中的部件提供它们运行所需要的控制信号。

　　介于同步、异步之间的一种折中。对各种不同的指令的微操作实行大部分采用同步控制，小部分采用异步控制的办法。

　　1.列出微操作命令的操作时间表。根据微操作节拍安排PG电子(中国)官方网站，列出微操作命令的操作时间表（包含各个机器周期，节拍下的每条指令完成的为操作控制信号）。

　　2.进行微操作信号综合。对微操作信号进行综合分析、归类，根据微操作时间表可写出各微操作控制信号的逻辑表达式并进行适当的简化。

　　3.画出微操作命令的逻辑图。根据逻辑表达式可画出对应每个微操作信号的逻辑电路图，并用逻辑门电路实现。

　　速度快（的速度取决于电路延迟），一旦设计完成后，就不能通过其他额外修改添加新功能（将控制部件视为专门产生固定时序控制信号的逻辑电路，用最少元件和取得最高速度作为设计目标）。

　　具有规整性，灵活性，可维护性等优点，但由于微程序采用了存储程序原理，所以每条指令都要从控制存储器中取一次，影响速度。

　　总线.申请分配阶段。由需要使用总线的主模块提出申请，经总线仲裁机构决定将下一传输周期的总线使用权授予某一申请者（分为传输请求，总线.寻址阶段。取得使用权的主模块通过总线发出本次要访问的从模块（或从设备）的地址及相关命令，启动参与本次传输的从模块。

　　1.中断方式时程序的切换，需要保护和恢复现场；而DMA处理预处理和后处理，其他操作均不占用CPU的任何资源

　　2.对中断请求的响应只发生在每条指令执行完毕时，而对DMA请求的响应可以发生在每个机器周期结束时，只要CPU不占用总线.终端传送需要CPU的干预，而DMA传送过程无需CPU的干预

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